请问在Buck中最小导通时间由什么决定？

qwertyIC · 发表于 2010-3-8 21:57:49

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本帖最后由 qwertyIC 于 2010-3-8 22:02 编辑

未命名.bmp

个时间是否是由系统的delay决定的？以大家非常熟悉的buck dc-dc mps的一datasheet框图为例：当发生ocp到PWM反相端时间delay为t1，然后经过驱动到开关管关断delay为t2。另外，导通时间从PWM正相端到开关管开启delay时间为t。则系统最小导通时间与（t2+t1)-t 强烈相关的吧？还有什么因素或delay影响呢？

allentel · 发表于 2010-3-9 14:54:46

除了你上面提到的外，还有CLK的脉宽，以及RS触发器的Set段到开关管开启延迟时间有关。

monday1 · 发表于 2010-7-5 22:53:06

學到不少原以為只是單純的跟OCP有關
都沒考慮到delay
感謝分享

cicixu · 发表于 2010-8-11 13:13:02

delay, driver speed

love_ic · 发表于 2010-8-13 14:27:06

除了你上面提到的外，还有CLK的脉宽，以及RS触发器的Set段到开关管开启延迟时间有关。
allentel 发表于 2010-3-9 14:54

登录/注册后可看大图

一般CLK的脉宽不会那么大吧，应该不会决定系统的最小倒通时间，尽管理论上有这种可能。

kangmao · 发表于 2014-3-21 08:57:53

分析的不错！

weilou · 发表于 2014-3-25 23:05:48

mos的结电容

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