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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › Cadence的总线说明
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Cadence的总线说明

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bitcat
发表于 2009-7-15 13:48:48 | 显示全部楼层 |阅读模式

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一直有人问cadence的总线是怎么标的，这次自己也碰到了，就贴上来与各位分享

Virtuoso Schematic Editor User Guide -- 2_ Understanding Connectivity and Naming Conventions

[ 本帖最后由 bitcat 于 2009-8-4 09:23 编辑 ]
Bus, cadence, 总线
cdsbus_s.PNG

abbr_84d666537bb6881ec447406f424c0953.rar

1.12 MB, 下载次数: 730 , 下载积分: 资产 -2 信元, 下载支出 2 信元

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发表于 2010-1-27 18:44:05 | 显示全部楼层
十分感谢，谢谢分享！
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deitywp
发表于 2010-6-18 19:43:16 | 显示全部楼层
thanks to share
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发表于 2010-7-28 10:51:39 | 显示全部楼层
十分感谢！
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suntou
发表于 2010-7-29 17:17:25 | 显示全部楼层
xixiexie
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发表于 2011-3-16 13:36:21 | 显示全部楼层
xixiexie
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发表于 2011-3-23 11:12:04 | 显示全部楼层
very good!!!!!!!!!!
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发表于 2011-4-8 11:41:01 | 显示全部楼层
谢谢楼主共享
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oppo_11
发表于 2011-5-11 11:18:57 | 显示全部楼层
xiexie
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发表于 2011-7-13 10:52:39 | 显示全部楼层
:victory:
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