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[求助] UVM仿真使用的是AXI的VIP,在仿真过程发现停在了sequence的uvm_send语句前 新人帖 New Freaco 昨天 17:41 059 Freaco 昨天 17:41
[原创] uvm_root学习总结 新人帖 attach_img New ryy0609 昨天 12:39 475 ryy0609 昨天 20:19
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[求助] bit A[15:0],随机出A[i]=1的个数为5,怎么随机比较好 zuiqiangzhe 2020-9-18 4103 anpengfei 2020-9-18 18:04
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[讨论] $mc_mirror 或 hdl_xmr 的作用 诸葛小天 2020-9-14 1170 A1985 2020-9-15 09:31
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[求助] verilog/sv为什么要有x这一状态,这一状态有什么意义? zhangjilong 2020-9-8 4307 viviy 2020-9-12 15:27
[求助] 利用uvm验证方法来验证iscas89基准电路,需要知道电路的功能吗 lqqqqqq 2020-9-5 0900 lqqqqqq 2020-9-5 11:32
[求助] uvm中进行软件复位和硬件复位的功能覆盖具体怎么收集 851018986 2020-9-4 6661 gaurson 2020-9-8 15:25
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[原创] 有没有人搞网络芯片类的验证? StephenChan 2020-9-4 4504 StephenChan 2020-9-14 09:40
[求助] spyglass Reset_check04报错 niloaixeuy 2020-9-4 0165 niloaixeuy 2020-9-4 11:34
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悬赏 [求助] systemverilog mailbox peek - [已解决] LY1310178117 2020-9-3 6851 LY1310178117 2020-9-4 09:14
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