testmax stil2Verilog 报错如何解决?

Aaron2099 · 发表于 2023-9-8 20:55:48

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这个问题如何解决，请大佬指点，谢谢。

登录/注册后可看大图

neo.yi · 发表于 2023-9-9 19:36:57

往回换个版本试试吧

Aaron2099 · 发表于 2023-9-11 14:16:22

neo.yi 发表于 2023-9-9 19:36
往回换个版本试试吧

没版本可换，因为要求版本一致。要不也不用求助了

Aaron2099 · 发表于 2023-10-10 15:06:45

按照文档安装，testmax目录里的 syn idq txs 路径不要改动，在环境变量里指定即可。

Aaron2099 · 发表于 2023-12-4 16:44:24

已解决

tracy6969 · 发表于 2023-12-5 03:00:41

Aaron2099 发表于 2023-12-4 16:44
已解决

solution?

a1286232225 · 发表于 2023-12-19 17:03:35

怎么解决的啊，大佬求指导

Aaron2099 · 发表于 2023-12-19 17:20:48

a1286232225 发表于 2023-12-19 17:03
怎么解决的啊，大佬求指导

买正版，有FAE提供技术支持。

a1286232225 · 发表于 2023-12-19 17:33:55

不想说算了，不用这个样子把，这里不是交流技术解决问题的吗；

Aaron2099 · 发表于 2023-12-20 10:45:07

a1286232225 发表于 2023-12-19 17:33
不想说算了，不用这个样子把，这里不是交流技术解决问题的吗；

我买了正版解决问题，这个为啥不能说？再说正版也不贵，不到百来万而已。

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