求助：virtuoso里面如何仿真数字电路（有报错图片）

790922706 · 发表于 2020-4-25 23:27:57

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求助各位大佬，我在virtuoso里面点击file-import-verilog把写的计数器verilog文件导入了进去，导入的时候我就只是把verilog文件添加进去，目标库选好，然后就点击确定，系统就提示导入成功。但是我拿这个计数器symbol做仿真的时候就报错，仿真不了……其实我也在思考一个问题，就是在virtuoso里面仿真数字电路，那是如何把对应的库文件与电路匹配的呢。。这个计数器导入进去只是一个symbol，没有schematic，也不能像模拟电路一样可以修改mos管的model name来对应到相应的库，就真不知道怎么办了…… 求助
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以上就是计数器仿真的时候报的错，说生成不了Netlist

xbuilder · 发表于 2021-7-9 10:44:26

请问解决了吗

jdh215933 · 发表于 2022-11-17 15:28:31

顶一下

Mark__pro1 · 发表于 2022-12-13 08:34:49

在ADE的setup中去找environment 然后再view list 中添加 “veriloga”，这样你写的veriloga的东西就能够生成网表了

荒何 · 发表于 2023-3-2 15:40:08

请问解决了吗

xiaoxiaotian · 发表于 2024-3-27 22:05:35

您好，请问这个问题解决了吗

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