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岗位职责: 1. 负责数字IC设计及验证 2. 负责ISP Pipeline硬件架构设计及规划 3. 负责将ISP algorithm硬件化 4. 优化ISP PPA (PowerPerformance and Area) 任职要求: 1. 本科及以上电子信息,微电子学,电路与系统,集成电路,通信,计算机,电子工程等相关科系 2. 3年以上数字IC设计经验 3. 具备以下经验者佳: a. Shading, HDR, AWB, AE, AF, Edge enhance,Demosaic, Noise Reduction, Depth, Dewarping 等ISP模块设计经验 b. SoC整合,合成经验 c. Low power经验 d. AI相关基本知识 e. 验证(Verification; 熟System Verilog)经验 f. 高级综合(HLS; High Level Synthesis) g. TV, LCD, Display等设计经验 h. FPGA设计经验 i. 具管理经验 4. 具备良好的Verilog编程能力前端EDAtool使用能力 5. 具备良好的英语读写能力
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