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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › 资源共享 › EDA资源使用讨论 › Verilog代码编写规范，大家可以借鉴一下
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楼主: kevin79

Verilog代码编写规范，大家可以借鉴一下

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song_song78
发表于 2008-7-12 08:40:14 | 显示全部楼层
Thanks
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dedekd
发表于 2008-7-12 08:43:59 | 显示全部楼层
Thank you
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snowding427
发表于 2008-7-26 16:27:38 | 显示全部楼层
那确实，好东西就是要好好顶顶下。
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thinkpub
发表于 2008-7-27 17:03:28 | 显示全部楼层
多谢了
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lyx403
发表于 2008-9-11 08:55:13 | 显示全部楼层
没钱呀
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vividsoft
发表于 2008-9-11 09:20:47 | 显示全部楼层
这东西应该没有什么标准吧。
编写代码当然要有一定风格，自己可以定义一个，然后严格执行。
注释不要太多，要简炼。
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dayikimo
发表于 2008-9-15 14:29:07 | 显示全部楼层
感謝大大的提供
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jamselee7395
发表于 2008-10-2 01:43:43 | 显示全部楼层

灌一下水

然后下载
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philio
发表于 2008-10-2 10:56:18 | 显示全部楼层
没钱怎么办呢？
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lalala002
发表于 2008-10-2 13:09:27 | 显示全部楼层
看一下是什么东东
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