求问有做过连续时间pipeline ADC的大佬们

nm2012 · 发表于 2024-11-10 17:00:17

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本帖最后由 nm2012 于 2024-11-10 20:49 编辑

这种架构，目前是不是只能用在一个时钟频点啊。看了些论文，发现测试结果里面也没有SFDR/SNDR versus fs的结果。求助，谢谢！

Adam_ht · 发表于 2024-11-12 09:25:17

是的，时钟不能变，Fin可变，一般只有SNDR vs Fin的Fig，并且这种架构对Buffer要求很高

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