assembly isolation

David.Z · 发表于 2024-1-4 13:31:21

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TS工艺里面seal ring的设计规则有个assembly isolation ，我按照规则画了个seal ring 跑DRC有个报错：Minimum width of Assembly isolation >=5um, 可是我所有器件距离seal ring已经隔了10um还是过不了，我看设计规则图解关于assembly isolation就是一片空白，跟器件隔开一定距离就行，为什么会报这个错，难道这片区域需要一个layer来覆盖吗，有没有做过的大佬帮忙给我解释一下。

David.Z · 发表于 2024-1-4 13:53:53

不用了帮忙了，刚发帖就找到问题所在了，已解决。

tiaotiaotang404 · 发表于 2024-1-12 10:17:21

我也遇到了相同问题，请问楼主这个问题是啥原因啊，是咋解决的啊，感谢解答

David.Z · 发表于 2024-1-12 13:58:00

tiaotiaotang404 发表于 2024-1-12 10:17
我也遇到了相同问题，请问楼主这个问题是啥原因啊，是咋解决的啊，感谢解答 ...

这个assembly isolation其实就是空白，啥都不画，我是因为pplus超出了sealring的范围一点点到了assembly isolation区域，所以报了个错。

tiaotiaotang404 · 发表于 2024-1-12 14:13:43

David.Z 发表于 2024-1-12 13:58
这个assembly isolation其实就是空白，啥都不画，我是因为pplus超出了sealring的范围一点点到了assembly ...

哦哦，好的好的，已经改好了，感谢！

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