DUT内部子模块信号验证

anpengfei · 发表于 2020-8-24 21:44:09

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求助大佬们，现DUT有7个模块，除了输出数据比对，还想验子模块的输出或者模块内部信号的正确性，ref data是读txt得到的，这种情况该怎么去搭环境？
之前也遇到过一次，我是整了几个env包着不同的mon、scb等，但是感觉这样很繁琐，有没有好的方法可以实现？
用SVA可以实现吗？具体怎么做……

meistin · 发表于 2020-8-25 10:33:04

谢谢啊啊楼坠啊

anpengfei · 发表于 2020-8-25 13:58:26

meistin 发表于 2020-8-25 10:33
谢谢啊啊楼坠啊

？？？这是来水的啊哈哈

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