uvm_root 有个小红叉

790922706 · 发表于 2020-5-21 00:13:02

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本帖最后由 790922706 于 2020-5-21 00:14 编辑

{`EOL@T`H$EAK1B83797P7U.png

如图，uvm_root有个红叉不知道怎么回事。

这是我的脚本：set UVM_HOME D:/modelsim10.4/verilog_src/uvm-1.1d
set WORK_HOME D:/modelsim10.4/project/uvm0
vlog +incdir+$UVM_HOME/src -L mtiAvm -L mtiOvm -L mtiUvm -L mtiUPF $UVM_HOME/src/uvm_pkg.sv $WORK_HOME/dut.sv $WORK_HOME/top_tb.sv
vsim -novopt -c -sv_lib D:/Modelsim10.4/uvm-1.1d/win64/uvm_dpi work.top_tb
run 100

这是输入脚本之后： YB6OOAZYW9D1VG$_N`IMSV3.png

然后波形上面都是ZZ XX态。
我想看UVM details，就给我报错这个：# UVM Details: design does not contain any UVM components, UVM debugging is disabled, or an unknown questa_uvm_pkg has been loaded.

代码我是用的张强书中的第二章最后一节的完整代码，跑的是Case0，不知道为什么会这样。。求大佬指点

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