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[讨论] GeSi工艺LVS改错求助

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发表于 2018-9-4 19:27:17 | 显示全部楼层 |阅读模式

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errors2.bmp errors1.bmp
发表于 2018-9-5 14:42:20 | 显示全部楼层
貌似这个器件m=2,你少接了一个gate
发表于 2018-9-10 14:01:05 | 显示全部楼层
结果看下面那个显示“多余”的管子如果跟上面那个m=1的管子是一样的话。应该接一起。就是相同的Gate S/D接法
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