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[求助] DDR3的数据和地址不用差分为什么能跑那么快？

发表于 2017-3-23 14:03:46 | 显示全部楼层 |阅读模式

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当从DDR读取数据时，从芯片输出的DQS和数据同时出现，但是PHY会将DQS延时90度，从而DQS刚好在DQ的稳定中间采样DQ
但是一般意义上说，CMOS工艺的TTL IO最多能跑到400MHz。为什么DDR3的数据和地址线能跑那么高频率？

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