如何收敛高速 ADC 时序

vipjph

更高速的 ADC 在转换器输出和接收机输入之间有严格的时序要求；知道如何利用产品说明书数字来保证无错误数字传输。

最近几年，高速、高精度的模数转换器 (ADC) 变得疾速。在 2006 年，一款业界一流的 12-位转换器才达到 250 兆采样/秒(MSPS)。而今天，这一速度已经翻了一番，达到了 500 MSPS。14-位和 16-位精度的类似发展趋势也日益明显。这表明，在比特精度不变的条件下，ADC速度正以几乎每年翻一番的速度发展。采样速率增长的结果是，收敛数字时序来确保您终端系统的数据完整性正变得越来越重要。

要收敛时序，需在 ADC 和数字接收机产品说明书中找到建立时间 (tsu) 和保持时间(th)。建立时间是接收机时钟沿之前数据必须有效的时间，而保持时间是时钟沿之后 ADC 数据必须有效的时间量（请参见参考文献1）。ADC的建立时间和保持时间加在一起便决定了时间数据是否有效。这样，长建立时间和保持时间是 ADC 的一种理想状态。

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bambucha2007

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