vcs仿真求助

gerry1812 · 发表于 2011-7-26 10:30:41

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大家好，我想把altera的quartus中的verilog库添加到vcs中，进行功能仿真。我是直接把quartus中的altera_mf.v文件放到了一个vcs的一个sim_lib文件夹中，然后利用+libexe.v 进行库扩展，在编译的文件中，我也添加了altera_mf.v文件，但是仿真的结果还是显示出库没能添加正确，请问大家一般在添加（扩展）vcs库时是怎么添加的，，最好能提供一个quartus库添加进vcs的例子，，谢谢各位！

benbenyan · 发表于 2011-7-27 11:32:36

我们一般只是将altera_mf.v直接进行编译

qiushulin0000 · 发表于 2011-7-31 22:53:14

+libext+.v -v /sim _lib/

gerry1812 · 发表于 2011-8-1 17:10:33

嗯，谢谢，已经添加成功，，vcs很好很强大，，大家多多讨论！

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