提升芯片投制设计的进度估算 3/3

st_eda123

提升芯片投制设计的进度估算
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以上的讨论倾向于反映出二线、三线业者中的不佳工程、营销与业务团队，多数公司里的多数设计、营销及业务团队都非常专注自有领域，并尝试造就大贡献，但却不关心公司的处境。一线、二线、三线间的进度不同是由于公司情境的好坏因素，其影响性高过于控制设计、营销、业务团队。与其把心力用于强化、缩短芯片的设计时间，则更建议专注在规划及问题排解，而不是对抗。
结论是，表中的28个委托投制案，其交托的客户已归为一线、二线、三线，同时也依不同线别来列出其委托案的平均设计复杂度。由表中可知，同样的芯片投制商，同样从交付netlist到完成GDSII，一线委托案所需的时日能比二线快约50%，而能比三线快约100%。所以，在此建议当修订原有的时程估算方法，过去仅以逻辑闸用量、内存容量、频率频率等技术复杂度的方式来估算芯片开制所需的时间，必须尝试调整成以业者一线、二线、三线等区别来推估开制时间。
不过，每家公司及其投制工程团队均有所不同，因此项目时程的修改、调整须以逐案、逐案累积而得的基础来评断，此亦成为一个有趣且值得深入探讨的议题，这牵涉到不同线别业者的前段设计时间，必须跟后段设计(从netlist到GDSII)一样良善才行。
作者：Bob Eisentstadt与Jim Bailey / 世芯电子(Alchip Technologies)

转载自电子工程专辑

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