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楼主: wwjghcy

关于PLL的问题,望高手指教!

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发表于 2010-4-14 11:46:08 | 显示全部楼层
好贴,顶下~~欢迎大家继续探讨~~~
发表于 2010-4-14 22:20:42 | 显示全部楼层
11# liuguojia612 对于运放中的-3db带宽大家都能理解,带宽限制了信号建立的速度,即输入一个阶跃电压信号,输出达到稳定所需的时间就和-3db带宽有关!
对于pll,只是把运放中的电信号变成了相位,频率的变换也可以归结为相位的变换,pll的输出也是为了跟踪输入相位的变化,因此和运放的建立是一个道理。pll的建立是相位-电压-相位的过程,因此-3db带宽就限制了相位跟踪的时间,最终影响到pll的锁定时间!不知道理解对不对,希望高手拍砖
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