运放失调电压的仿真

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9874748x 发表于 2023-8-7 15:39
想问您的意思是 dc仿出来的这种管子理想情况下的就是系统失调，同样的testbench用MC就是仿的随机失调是吗 ...

系统失调就是你自己本身设计的时候存在的失调 可以理解为电路在DC仿真时候输入端呈现出来的不对称的情况

随机失调是后期在制造过程中无法控制引入的失调 例如版图绘制带来的寄生不匹配问题 电路制造存在的浓度不一样的现象 因此在设计是需要将这些因素考虑进去
个人理解哈