对于DC后仿真和PT后仿真的困惑

西门电工 · 发表于 2018-12-27 17:29:09

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小白今天今天做了一下DC综合后的仿真，发现了一些不理解的地方，请求给与帮助；
1. 就是没有反标DC吐出来的sdf文件时，发现仿真DC网表的时候，已经存在了延时信息；但是反标了sdf文件之后发现仿真进行不下去，就是会出出现一些不定态；担心时因为时序违例，就降低了时钟频率，发现还是一样；具体问题时出在了哪里？vcs已经提醒了反标时成功的；

2.第二个疑问就是PT吐出来的sdf和DC吐出来的sdf有什么区别？PT后仿真时候，用的网表和DC吐出来的网表一样吗？

西门电工 · 发表于 2019-1-2 20:59:22

感谢，理解了；

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