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仿真电路是一个VCO挂三级CML,除了VCO自己和第一级CML上有电感,后边两个CML都靠独立器件来搭。
我想看看VCO加CML后的PN是多少,于是就仿了这一个电路。
现在的情况是这样, 预期在VCO所有的VC和sub band 的选择都设到最高时,VCO自己会输出一个40.64G左右的正弦波形。经过三级CML 除以8之后,应该输出一个5.08G左右的波形。
pss选择HB引擎,oscillator 选中,选择最后一级CML的输出为oscillator node。pnoise 分别看最后一级CML、倒数第二级CML、正数第一级CML、VCO buffer自己的输出,relative band分别取为1,2,4,8.
仿真结果就很妙了,tstab段应该够长了,看到各级输出都比较稳定了,自己在波形图上测量一下各级输出波形的震荡周期也差不多符合预期。但HB 收敛到就是认为最后一级的输出应该是5.147G左右,当然随着这个频率的变化,其他各级的输出也分别跟着X2、X4、X8倍的比预期频率上涨了。
这还不算完,理论上来讲,CML自己的PN应该远比前级输入的噪声要小,理论上每过一个CML PN就会下降-6dB左右,但目前仿真会看到最后一级5.147G的PN在10K以下还满足这个关系,但在10K以上就迅速变平了?不知道这里PN特别差是否跟HB引擎算出来的震荡频率偏移有关。但如果有关,为何前级CML和VCO的PN没有受到影响呢?
pss选择HB引擎,主要是因为pdk库里的毫米波器件自己内部带tline这种分布式器件,拿shooting跑不起来。
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