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职位描述
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有3 – 5年的行业内最新的全定制模拟和IO电路版图设计经验;有40nm/28nm的设计经验者优先考虑; •
有完整的芯片级方面布局布线的经验; •
熟悉并掌握版图布局等概念,时序设计规则及半导体工艺技术知识; •
具有asic 自动布局布线流程(RTL-GDS)经验者优先; •
具有良好的沟通能力,能够通过团队合作的方式探讨和解决各种问题。
职位要求 •
电子或电气工程类专业的学士或硕士学位,3-5年行业最新模拟和IO电路版图设计经验。 联系方式 •
hr@capital-micro.com |