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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › 版图进行LVS验证时电容报错
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查看: 4271|回复: 7

[求助] 版图进行LVS验证时电容报错

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xhfwithe
发表于 2017-6-25 23:01:19 | 显示全部楼层 |阅读模式

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小弟用的是上华BCD.25工艺库，在进行LVS时，使用的pip电容有错，提示错误为“No matching SUBCKT for cpip5V_ono at line 58 in file “/home/PDK/DRC/bg_0316.src.net””，请问各位大神是不是电路生成的网表有问题，如何进行修改啊？？？
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maomao198477
发表于 2017-6-26 08:58:20 | 显示全部楼层
是不是要 include source.cdl 咋的？？？
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kevin_l
发表于 2017-6-26 09:33:30 | 显示全部楼层
回复 2# maomao198477
你是不是在run lvs时要include一个header文件？
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motofatfat
发表于 2017-6-26 09:43:39 | 显示全部楼层
同意樓上的說法
沒有 cpip5V_ono 的 網表在裡面
找一下 include 的 subckt
自己加也行 , 通常是
.SUBCKT cpip5V_ono  pin1 pin2 pin3
.ENDS
有幾pin 就寫幾pin
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xhfwithe
 楼主| 发表于 2017-6-26 09:59:56 | 显示全部楼层
http://bbs.eetop.cn/thread-321839-1-1.html
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hccaiwh
发表于 2017-6-26 14:32:49 | 显示全部楼层
是不是你生成的网表里面电容名字和lvs里面的不一样哦
所以你要自己写提取文件，或者手动改网表了
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xhfwithe
 楼主| 发表于 2017-6-26 18:20:30 | 显示全部楼层
回复 6# hccaiwh


    已经解决了，就是上面那篇帖子
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西柚少女
发表于 2020-4-18 17:12:35 | 显示全部楼层


hccaiwh 发表于 2017-6-26 14:32
是不是你生成的网表里面电容名字和lvs里面的不一样哦
所以你要自己写提取文件，或者手动改网表了 ...


你好  我想问一下  生成的网表是指xx.sp吗  还是哪个？
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