OP輸出glitch疑問

few1121 · 发表于 2016-4-4 16:16:16

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用hspice搭了一個sdm 看了一下fully diff OP輸出有很嚴重的glitch

glitch時間點是在積分phase 一開始的時候,看了一下是dac回去電壓在兩端輸入所造成

但是測完PSD沒問題,只是這個glitch不太能接受,搞了好久都弄不掉

曾改過mos開關試著讓導通電阻變大但是會讓noise floor上升

想請問這是什麼原因要怎麼改善, 會是時序問題嗎還是OP問題

麻煩大神幫忙阿!!!!

kwankwaner · 发表于 2016-4-4 22:04:17

积分电容的系数调一调吧，零点的问题

few1121 · 发表于 2016-4-5 12:33:20

回复 2# kwankwaner

你好我目前是用一階的SDM 照理是沒有零點的請問要怎麼調呢

kwankwaner · 发表于 2016-4-5 21:52:04

回复 3# few1121

运放跨接电容就有零点啊，可以试试跨接电容串个电阻，或者增大这个电容

[求助] OP輸出glitch疑問

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