bsim4 veriloga code

andy2000a · 发表于 2015-5-20 13:38:29

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先前有找到ekv veriloga model
但没有 bsim4

不过先前发在另区文好像还要审核 ? 无法自己修改

刚刚找到 bsim4 va file

bsim.va.rar rename bsim4.va
try

bsim.va.rar (170.59 KB, 下载次数: 134 )

zip compress text file

bsim.zip (30.04 KB, 下载次数: 86 )

andy2000a · 发表于 2015-5-28 15:06:34

回复 1# andy2000a

models.zip (13.9 KB, 下载次数: 54 )

Find tanner EDA have some verilogA model file

some eda tool have example

some model bjt resistor ldmos

mentor merge Tanner .

以前cadence 买下一家pc上做placeroutesnake 公司后就没了, 现在 x86 cpu 速度越来越快了没有
一定须要跑在linux, 而且最大问题是eda卖太贵了
.希望
winbase EDA 软件可以便宜点
.MentorGarphics 如果把tannereda 加入
modelsim就应该很全了

Sedit

Ledit

Tspice

Co-sim
?? 先前 dolphin_ smash 也不错
, 不知道将来会不会也被其它merge

陈峰mbsky · 发表于 2015-6-5 16:55:50

死都找不到jfet的veriloga源代码有没有好的网站分享下

andy2000a · 发表于 2015-6-5 17:14:47

死都找不到jfet的veriloga源代码有没有好的网站分享下
陈峰mbsky 发表于 2015-6-5 16:55

登录/注册后可看大图

jfet.zip (2.03 KB, 下载次数: 36 )

陈峰mbsky · 发表于 2015-6-9 23:23:45

回复 4# andy2000a

很给力多谢了已经用上了但是好像部分参数，跟默认比如hspice的help文档里所说的jfet 不完全一样

andy2000a · 发表于 2015-6-10 13:49:09

this from Tanner EDA

tspice
so .. maybe differenence with hspice

iyahsue · 发表于 2015-6-23 11:06:43

goooooooooooooooooooooooooood

yuzhi · 发表于 2016-2-7 22:35:02

very good，too happy to say anything

yuzhi · 发表于 2016-2-7 22:36:17

very good，too happy to say anything

wushangkeji · 发表于 2016-9-7 22:39:33

多谢多谢！！！

[资料] bsim4 veriloga code

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