lvs rule中如何定义区别两个地?

思奇 · 发表于 2014-2-25 02:40:07

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如图 pguardring接vss，而左侧的反相器在pguardring外，做lvs时其地被识别成另外一个信号。应该是被识为环里环外是两个地了，请问rule中什么定义导致这个结果?

le_levi · 发表于 2014-2-25 08:50:56

你要问的具体是什么问题？是想说应该只有一个地，还是说应该有两个不同的地？
另外看你这版图就觉得有问题，你看看你的反相器是怎么接电位的，你的DRC也没过吧？仔细检查一下

思奇 · 发表于 2014-2-25 09:07:25

回复 2# le_levi

Guardring内外是同一个地
DRC是OK的反相器接法没有问题
如果将闭合的地环打开个缺口lvs是OK的，如果地环闭合，反相器的地被识别成别外一个net

motofatfat · 发表于 2014-2-25 09:22:34

通常用 psub2 layer (T晶元代工) 區別 nmos 的 body

anothermomo · 发表于 2014-2-25 09:28:47

回复 1# 思奇

你的环外边的反相器的p、n的位置要对调一下啊

professor_h · 发表于 2014-2-25 09:31:38

以前我也遇到过这种问题，不过是关于我用的工艺中有个叫基板分离层（SEPGND）的层次覆盖的关系，sepgend层是要将nmos和其对应的sub覆盖在一起的，否则就会出现有两个net的情况。
不过你那个是不是这个问题，就不清楚了~~仅供参考一下。

tuohong · 发表于 2014-2-25 09:40:33

楼主你的发帖时间、注册时间都很恐怖啊。

我想这个是command file语句的结构问题，或者说是calibre语法问题，正常是一个环隔离，隔离内外通过ring的下面是互通的，但是机器识别这两块儿是完全隔离的，这就是为什么挖了个开口就可以识别成等电位的原因。语法上很难解决，layout上可以用metal把内外直连好了。

思奇 · 发表于 2014-2-25 11:03:24

感觉地环像电环(N阱环）一闭合就将衬底分为两个电位了

tuohong · 发表于 2014-2-25 11:11:44

回复 8# 思奇

是的，因为语句只有平面概念、没有立体概念。这个是先天缺陷，很难避免。

le_levi · 发表于 2014-2-25 11:12:02

回复 3# 思奇

仔细看你的版图也看不清楚，貌似你的inv的存底电位接法是不对的，你要是确认这个没问题，然后run lvs 还是报错不同的vss net，那么你添加一层PSUB2试试看，要是还是有问题，就是你版图本身有问题

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