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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VMM for SystemVerilog （夏宇闻中文版）

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楼主: saintgang

[资料] VMM for SystemVerilog （夏宇闻中文版）

发表于 2010-8-3 09:09:36 | 显示全部楼层

好书谢谢楼主

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发表于 2010-8-3 22:37:01 | 显示全部楼层

thanks!

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发表于 2010-8-3 22:38:34 | 显示全部楼层

thanks

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发表于 2010-8-3 22:40:07 | 显示全部楼层

thanks!

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发表于 2010-8-3 22:42:58 | 显示全部楼层

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发表于 2010-8-3 22:45:10 | 显示全部楼层

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发表于 2010-8-3 22:49:37 | 显示全部楼层

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发表于 2010-8-3 22:52:41 | 显示全部楼层

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发表于 2010-8-3 23:01:39 | 显示全部楼层

thanks!

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发表于 2010-8-3 23:04:01 | 显示全部楼层

thanks!

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