calibre lvs 电阻问题

chenmh_henry · 发表于 2010-5-31 19:35:04

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请教：
calibre lvs 时电阻不比较阻值的大小，而是比较schematic和layout上L和W的值，该怎么设置，急着救命，谢谢

有宋 · 发表于 2010-5-31 20:29:01

lvs文件里面有设置
#define res_porperty other
中的other改为resistance
当然，不一定是一模一样的一句话，但类似，自己找一下
仔细看看lvs的执行文件就可以找到的

jerykot · 发表于 2010-5-31 20:40:03

看有没有一个是设置成size的

lwjbh · 发表于 2010-5-31 21:14:18

在lvs rule中搜索property应该能找到，记得有trace property ....

dabing · 发表于 2010-6-1 14:41:22

1# chenmh_henry
首先，你查看一下你比较的电阻的model，将定义该器件的property修改为W，L，再找到该model的trace property，将trace property改为w和l即可
DEVICE element_name(model_name) *******[
property w,l
***
***
***
]
trace property R(model_name) w w 0
trace property R(model_name) l l 0
建议你修改的时候查看一下calibre的帮助文档svur_ur.pdf

topeeit · 发表于 2010-6-2 18:24:10

lvs command file裡修改 #define

simon_19851202 · 发表于 2010-6-4 14:23:02

大兄弟,您悲剧了.....

dilyyao · 发表于 2010-6-28 14:02:41

thanks

1973 · 发表于 2013-7-23 14:37:34

回复 1# chenmh_henry

修改LVS的规则，减小精度即可。

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