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一、数据设置概述
后端数据设置主要针对:前端设计继承的综合数据以及后端的物理数据。
综合数据主要是前端设计设置过的逻辑、时序库文件、设计约束文件sdc、综合网表文件。
物理数据主要是标准单元、内存RAM等IP核、IO管脚三类物理库文件,工艺和设计规则相关的技术文件tf,连线延迟的RC模型(TLU+文件)
二、逻辑库设置
逻辑库文件包括标准单元(NAND、NOR、XOR、DFF)的时序与功能信息、Macro Cell(RAM ROM IP核)的时序,驱动定义以及负载设计规则(最大/最小扇出、最大/最小电容负载、最大/最小信号延迟)
设置顺序:
a.读入门级网表:
read_ddc(读入ddc设计属性信息)
read_verilog xx.v
read_vhdl xx.vhdl
b.实例化设计调整:
current_design xx
uniquify
c.链接库 library
set link_library"* gates.db io.db rams.db xx.db"
d.设置搜索路径
lappend search_path ./xx/xxx/xxx
e.目标库设置
set target_library "xx.db"一般情况下只能指向标准单元库