谁熟悉digital synthesis?

orientview · 发表于 2024-11-13 19:34:05

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站内联系。

Tang00 · 发表于 2024-11-14 14:23:11

DC 还是genus

orientview · 发表于 2024-11-14 21:54:14

Tang00 发表于 2024-11-14 14:23
DC 还是genus

genus

Tang00 · 发表于 2024-11-15 15:07:19

orientview 发表于 2024-11-14 21:54
genus

什么问题

orientview · 发表于 2024-11-15 16:01:49

Tang00 发表于 2024-11-15 15:07
什么问题

就是有没有操作流程的视频啊？

目前我想用verilog来生成一个分频器，然后导入到virtuoso里，跟其它模拟电路一起使用。

这整个流程，该怎么弄？

Tang00 · 发表于 2024-11-15 16:44:33

orientview 发表于 2024-11-15 16:01
就是有没有操作流程的视频啊？

没有视频，看看 user guide就行

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