axi dma如果想支持读交织的话，应该怎么操作？【已解决】

modoalos · 发表于 2023-7-5 17:09:47

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本帖最后由 modoalos 于 2023-7-7 14:23 编辑

新人想设计一个支持读交织的axi接口的dma，有一个问题没想明白，读回来的id不同的数据，应该怎么重新排序？

lsh361 · 发表于 2023-7-5 17:34:05

加cache存着

modoalos · 发表于 2023-7-5 17:55:19

lsh361 发表于 2023-7-5 17:34
加cache存着

是不是不同id放在不同的地址里来实现重新排序？我本来是想把axi读到的数据存到FIFO里，再等目的端请求之后，从FIFO里把数据取出来送到写通道，但FIFO的地址不是自己选的，这样想一下是不是就不能用FIFO了？

lsh361 · 发表于 2023-7-6 15:16:20

fifo的话支持几个乱序就用几个fifo

modoalos · 发表于 2023-7-6 15:57:33

lsh361 发表于 2023-7-6 15:16
fifo的话支持几个乱序就用几个fifo

大佬，如果我的AXI也支持outstanding，那我每个FIFO的深度是不是也要和outstanding的最大值有关

lsh361 · 发表于 2023-7-6 17:32:57

使用FIFO设计起来容易，但是比较浪费，还是cache比较好，维护cache id，从当前指针依次回环更新

modoalos · 发表于 2023-7-7 14:22:54

lsh361 发表于 2023-7-6 17:32
使用FIFO设计起来容易，但是比较浪费，还是cache比较好，维护cache id，从当前指针依次回环更新 ...

懂了懂了，感谢大佬

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