modelsim分模块仿真的延时问题

加油99 · 发表于 2013-5-20 14:20:24

都是阻塞赋值问题。
未分解的模块中，那个if(a==0)语句赋值的k，是会影响if(k==0)语句执行结果的，所以a决定b是这段代码所表达的逻辑。显然，这不是你的本意。

qiudanyi1 · 发表于 2013-5-20 14:23:27

在第一个没有分解的module里面两个if判断是在一个begin end 块里面的虽然begin end块内是顺序执行的但是是在一个时钟上升沿到来的时候完成的，这样就会出现你仿真的结果，而当你分解玩以后连个if是并行执行的，信号到达管脚的延时不一定是一样的，所有就会造成module1中k已经等于1了而module2没有采到这样只能等到下一个时钟的上升沿才会采到值，就会出现你仿真的情况，不知道我理解对不对

匡子语 · 发表于 2013-5-20 15:37:09

回复 11# 加油99

理解了一半吧- -！感觉自己还是太弱了，刚刚看了个代码风格的帖子，那些不该犯的错误我基本都犯遍了。估计我还要多些点代码才能理解吧。

真的是万分感谢~

匡子语 · 发表于 2013-5-20 15:38:32

回复 12# qiudanyi1

好像有点道理
谢谢啦

goyanod · 发表于 2013-5-21 09:25:09

请高手指教

guodaqn · 发表于 2014-10-25 18:48:08

想知道，模块嵌套调用的时候，用modesim该怎么仿真啊

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