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地址:上海,深圳,北京,杭州,西安,成都,苏州,南京
咨询微信:thomas-44444444
薪资范围:80-140万
岗位职责:
1.从算法级理解模块数据结构,用全定制方法实现设计;
2.完成网表设计,包括时钟树结构,逻辑设计,器件选型等;
3.完成全定制网表的floorplan规划和器件摆放 ;
4.完成全定制模块的signoff ,包括setup/hold/transition/fanout等;
5.对设计做PPA优化;
任职要求:
1.电子类相关专业硕士毕业,5年以上前端设计开发经验;
2.熟练掌握Verilog、Perl/Python/Shell/Tcl语言;
3.熟悉常用仿真、综合、形式验证和STA工具;对后端工具有一定了解;
4.强烈学习新技术的愿望,追求技术精益求精,勇于打破部门工种边界,突破颠覆常规方法方案;
5.具备较强逻辑思维,能团队合作,也能独当一面
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