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- #ifndef __CPU_H
- #define __CPU_H
- #include "stm32f10x.h"
- #include "sys.h"
- #define FPGA_RST PEout(1) //FPGAD¾Æ¬¸′λ1|Äü￡¬μíμçƽòì2½¸′λ 1--Î′¸′λ 0--¸′λ PE1
- #define FPGA_CS PDout(0) //ƬѡFPGA 0--Î′Ñ¡éÏ 1--Ñ¡éÏ CPU_IDAT0 PD0
- #define FPGA_WR PDout(3) //D′FPGAê1Äü¶Ë ￡» 1 -D′FPGA CPU_IDAT2 PD3
- //#define FPGA_A PDout(1) //¶áD′FPGAê±êy¾YÃüáî¿ØÖÆ×Ö 1--¶áD′Ãüáî 0--¶áD′êy¾Y CPU_IDAT1 PD1
- //#define FPGA_RD PCout(11) //¶áFPGAê1Äü¶Ë 1-¶áFPGA
- #define FPGA_DONE PCout(9) //êäèë1ü½Å 1-FPGAÅäÖÃíê3é 0--Î′íê3é FPGA_DONE PC9
- #define DATA0 PDout(5)
- #define DATA1 PDout(6)
- #define DATA2 PDout(7)
- #define DATA3 PDout(13)
- #define DATA4 PDout(14)
- #define DATA5 PDout(15)
- #define DATA6 PDout(12)
- #define DATA7 PCout(8)
- #define DATA8 PCout(10)
- #define DATA9 PCout(11)
- #define DATA10 PDout(10)
- #define DATA11 PDout(11)
- #define DATA12 PCout(6)
- #define DATA13 PCout(7)
- #define DATA14 PCout(12)
- #define DATA15 PDout(2)
- void Parallel_Init(void);
- void Dataout(u16 data);
- void write_data(u16 data);
- void write_data_num(u16 *str ,u16 num);
- #endif
复制代码
- //******************************************************************************
- // @file cpu.c
- // @author wuzhicheng
- // @version V01.01
- // @date 2016Äê12ÔÂ20èÕ
- // Description : 2￠DD×üÏß′|àí.
- //******************************************************************************
- #include "stm32f10x.h"
- #include "cpu.h"
- #include "delay.h"
- //#define set_in() {GPIOD->CRL=0X88888888;GPIOD->ODR=0XFFFF;}//PD0-7 éÏà-êäèë //è«2¿êä3ö¸ß
- //#define set_out() {GPIOD->CRL=0X33333333;GPIOD->ODR=0XFFFF;
- // GPIOD->CRL=0X33333333;GPIOD->ODR=0XFFFF;}//PD0-7 éÏà-êä3ö //è«2¿êä3ö¸ß
- // ******************************************************************************
- // oˉêyÃû￡o void Parallel_Init(void)
- // 1|ÄüÃèêö￡o ½ó¿ú3õê¼»ˉ
- // êäèë2Îêy￡o ÎT
- // ±»μ÷óÃoˉêy￡oÎT
- // ******************************************************************************
- void Parallel_Init(void)
- {
- RCC->APB2ENR|=1<<4; //PORTCê±Öóê1Äü PC6,7,8,10,11,12 6GE; PC9
- RCC->APB2ENR|=1<<5; //PORTDê±Öóê1Äü PD2,5,6,7,10,11,12,13,14,15 10GE PD0 PD3
- RCC->APB2ENR|=1<<6; //PORTEê±Öóê1Äü PE1￡¬
- GPIOC->CRL&=0X33000000; //í¨óÃíÆíìêä3öÄ￡ê½￡PPC6 PC7
- GPIOC->CRH&=0X00033383; //í¨óÃíÆíìêä3öÄ￡ê½￡PPC8 PC10 PC11 PC12￡¬PC9éèÖÃÎaéÏà-/ÏÂà-êäèë-1000￡»
- GPIOC->ODR|=0XFFFF; //è«2¿éèÖÃÎaêä3ö¸ßμçƽ￡»
- //GPIOC->ODR|=0X1DC0; //0001_1101_1100_0000
- GPIOD->CRL&=0X33303303; //í¨óÃíÆíìêä3öÄ￡ê½￡PPD0 PD2 PD3 PD5 PD6 PD7
- GPIOD->CRH&=0X33333300; //í¨óÃíÆíìêä3öÄ￡ê½￡PPD10 PD11 PD12 PD13 PD14 PD15
- GPIOD->ODR|=0XFFFF; //è«2¿éèÖÃÎaêä3ö¸ßμçƽ
- //GPIOD->ODR|=0XFCE4; //1111_1100_1110_0100
- GPIOE->CRL&=0X00000030;//éèÖÃPE1Îaí¨óÃíÆíìêä3öÄ￡ê½ -0011
- }
- // ******************************************************************************
- // oˉêyÃû void Dataout(u16 data)
- // 1|ÄüÃèêö êy¾Yêä3ö
- // êäèë2Îêy data òaêäèëμÄêy¾Y
- // Ïè¾öìõ¼t IO¿ú±ØDèÏèéèÖÃÎaêä3ö¿ú
- // ±»μ÷óÃoˉêy ÎT
- // ******************************************************************************
- void Dataout(u16 data)
- {
- DATA0 = data>>15;
- DATA1 = data>>14;
- DATA2 = data>>13;
- DATA3 = data>>12;
- DATA4 = data>>11;
- DATA5 = data>>10;
- DATA6 = data>>9;
- DATA7 = data>>8;
- DATA8 = data>>7;
- DATA9 = data>>6;
- DATA10 = data>>5;
- DATA11 = data>>4;
- DATA12 = data>>3;
- DATA13 = data>>2;
- DATA14 = data>>1;
- DATA15 = data;
- //GPIOC->ODR=(GPIOC->ODR&0xe23f)|data; //GPIOC->ODR&0XE23F; 1110_0010_0011_1111
- //GPIOD->ODR=(GPIOD->ODR&0x031b)|data; //GPIOD->ODR&0x1dc0 0000_0011_0001_1011
- }
- // ******************************************************************************
- // oˉêyÃû void write_data(u16 data)
- // 1|ÄüÃèêö D′êy¾Y
- // êäèë2Îêy data 16λêy¾Y
- // ±»μ÷óÃoˉêy Dataout(data);
- // ******************************************************************************
- void write_data(u16 data)
- {
- FPGA_CS = 1;
- delay_us(1);
- FPGA_WR = 0;
- delay_us(1);
- Dataout(data);
- delay_us(1);
- FPGA_WR=1;
- delay_us(5);
- FPGA_WR=0;
- delay_us(5);
- FPGA_CS = 0;
- }
- //*******************************************************************************
- // oˉêyÃû: void write_data_num(u16 *str,u16 num)
- // 1|ÄüÃèêö: D′èëÖ¸μã3¤¶èμÄêy¾Y
- // êäèë2Îêy: *str 16λêy¾Y×é; u16 êy¾Y¸öêy￡»
- // ±»μ÷óÃoˉêy write_data( u16 data);
- //*******************************************************************************
- void write_data_num(u16 *str ,u16 num)
- {
- u16 i=0;
- for(i=0;i<num;i++)
- {
- write_data(str[i]);
- delay_us(100);
- }
- }
复制代码
- #include "sys.h"
- #include "delay.h"
- #include "cpu.h"
- //#include "w25qxx.h"
- //******************************************************************************
- //oˉêyÃû￡o int main(void)
- //1|ÄüÃèêö￡o Ö÷oˉêy￡¬Ä￡Äa80802￠DD×üÏß￡¬·￠Ëíêy¾Yμ½FPGA
- //êäèë2Îêy￡o ÎT
- //±»μ÷óÃoˉêy￡oÎT
- //******************************************************************************
- //òaD′èëμ½W25Q128μÄ×Ö·û′®êy×é
- //u16 spi_Buffer[2048];
- //#define SIZE sizeof (spi_Buffer)
- int main(void)
- {
- //u16 datatemp[SIZE];
- u16 spi_Buffer[2048];
- u16 i;
- u16 num = 2048;
- //u32 wraddr = 0;
- Stm32_Clock_Init(9); //Ïμí3ê±ÖóéèÖÃ
- delay_init(72); //Ñóê±3õê¼»ˉ
- //W25QXX_Init(); //W25QXX3õê¼»ˉ
- Parallel_Init(); //2￠¿ú3õê¼»ˉ;
- for(i=0; i<num; i++) //2úéúêy×é;
- {
- spi_Buffer[i]=i;
- }
- //W25QXX_Write((u16*)spi_Buffer,wraddr,SIZE);
- //delay_ms(500);
- //W25QXX_Read(datatemp,wraddr,SIZE); //¶á3öSIZE¸ö×Ö½ú
- //delay_ms(500);
- FPGA_RST = 0;
- delay_ms(500);
- FPGA_RST = 1;
- delay_ms(500);
- delay_ms(500);
- write_data_num(spi_Buffer,num); //êy¾Y¾-2￠¿ú·￠Ëíμ½FPGA
- delay_ms(500);
- }
复制代码
这是我这边编写的部分代码，大致意思是将16位并行数据发送至fpga，模拟的是8080并行口，但是没有读的部分，也没有地址，在FPGA部分设置双口RAM缓存数据，考虑到是按顺序存储，就自加产生写地址；FPGA部分编写完成，功能仿真也可以，但是好像数据没有发送过去，不知问题出在哪儿，STM32刚学习不久，所以怀疑这边出现问题，希望大家可以帮我看看。多多指点！万分感谢！
（本来还有一部分读写W25Q16部分，因为数据是先缓冲到那里面，但是考虑到一步一步调试，所以先注销了，后面再研究） |
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发表于 2016-12-23 15:03:25
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