请教占空比50%的5分频电路的原理

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请问这个电路怎么做到占空比为50%的5分频，

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victor0o0 发表于 2020-4-20 11:26
占空比50%的五分频是用到时钟下降沿了吧

你好，能详细一点吗，目前我只知道A、B相对CLK是占空比不为50%的五分频，但是图下方的两个或门加与门就得出了占空比为50%，没明白其中的原理

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突然不想平凡 发表于 2021-10-19 09:46
楼主你解决了吗？，能否也告诉我一下原理，我没太分析清楚

B'为占空比3/5的五分频，如果想得到占空比1/2，可以利用时钟的下降沿，即B'和clk进行或运算，得到一个在2.5个clk翻转的信号。信号A只有在第一个clk是高电平，其余4个clk均为低电平，所以clk/5前2.5clk与（B'和clk进行或运算的结果)保持一样，后2.5clk输出低电平。

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tang66521 发表于 2021-10-22 15:56
这样得到的50%占空比需要输入CLK也得是50%占空比，感觉多此一举了

不是很明白你说的“感觉多此一举”，你会采用哪种结构呢？

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tang66521 发表于 2021-10-22 17:33
你输入的 50% “CLK"是怎么产生的

可以外部供给，也可以是环形振荡器产生...

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tang66521 发表于 2021-10-22 17:59
外部的不考虑。假设是你内部振荡器产生的。你需要一个50 % 的CLK，那大概率是某个频率/2得到的，即振荡器的 ...

我没能理解你的意思，假设振荡器输出60MHz(占空比约1/2),现在需要一个12MHz的时钟信号（占空比约为1/2），你会怎么用基本逻辑单元搭建？
第一张图是采用三个触发器构成的计数器实现5分频，然后经过组合逻辑得到需要的信号。