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标题: 设计的filter线性度一直不好，做过的过来给个意见吧 [打印本页]

作者: 遇见爱0107 时间: 2018-1-20 19:49
标题: 设计的filter线性度一直不好，做过的过来给个意见吧
最近在做一个一阶filter，很简单的电路，但是线性度就是不好，THD=-31dB。图1是电路结构，图2是仿真结果。
有做过的吗？图片的现象是什么原因导致的？大家给个意见，这个是哪里的问题？往哪个方向更改。

谢谢。

仿真条件：输入isin的频率fin=10M，电流源为理想电流源。ss-corner，vdd=1.42V， T=80.

(, 下载次数: 54 )

图1 电路结构

测试结果

输出结果： (, 下载次数: 53 )

电路LG：
(, 下载次数: 52 )

作者: nm2012 时间: 2018-1-20 23:41
你OP里面那一对连在一起的pmos和nmos是不是有问题啊，怎么没有电流路径呢

作者: 遇见爱0107 时间: 2018-1-21 09:55
回复 2# nm2012

不好意思，这个忘了画出来，有通路，偏置没有问题。

作者: nfleilc 时间: 2018-1-21 12:03
回复 3# 遇见爱0107

主要原因是运放工作电压太低，你现在工作电压1.42V，输出级上下各一个MO器件，按照0.2V的饱和电压计算，输出共模范围最多0.2V-1.22V，而你的输出已经超过这个范围了，所以在接近满幅度的时候线性度较差。
解决方案：提高工作电压，将共模设置在VDD/2，或者降低输出信号幅度。

作者: ksg12 时间: 2018-1-21 17:14
这种失真，大信号的问题。

作者: 遇见爱0107 时间: 2018-1-22 09:22
回复 4# nfleilc

工作电压已经无法调整，我尝试一下调整输出幅度吧，谢谢。

作者: 遇见爱0107 时间: 2018-1-22 09:23
回复 5# ksg12

好的，谢谢！

作者: afujian 时间: 2018-1-22 10:01
负载必须是250电阻？

作者: vdslafe 时间: 2018-1-22 11:25
线路图画对了？

作者: 遇见爱0107 时间: 2018-1-23 08:46
回复 8# afujian

对，负载改变不了

作者: 遇见爱0107 时间: 2018-1-23 08:47
回复 9# vdslafe

偏置电路没有画出来

作者: vdslafe 时间: 2018-1-23 09:48
回复 11# 遇见爱0107

class-AB 运放画对了？还有补偿？是到地？

作者: afujian 时间: 2018-1-23 09:53
回复 10# 遇见爱0107
负载应该不是直接到地吧？如果必须是那就只能是改OP了，驱动能力不足。

作者: 遇见爱0107 时间: 2018-1-24 10:45
回复 12# vdslafe

对，补偿是到地。ClassAB没有错吧？我

作者: 遇见爱0107 时间: 2018-1-24 10:50
回复 13# afujian

这个更改过来了，THD会好一些，但是还是不能满足要求，曲线和上面差不太多。

作者: vdslafe 时间: 2018-1-24 15:20
回复 14# 遇见爱0107

为什么补偿是到地？有啥好处？

作者: 遇见爱0107 时间: 2018-1-24 21:00
回复 16# vdslafe

借鉴别人的电路设计的，目前不清楚这个地方接地的好处。

作者: vdslafe 时间: 2018-1-24 22:37
class-AB也是借鉴？是不是图提错了？

作者: 122013137 时间: 2018-1-25 00:35
class-AB 运放画对了？a

作者: lynker 时间: 2018-1-29 10:00
可以看下p1dB，设计值可能偏小了

作者: analog123 时间: 2018-1-29 14:45
input 电路有问题

作者: bayvoice 时间: 2018-1-30 01:57
你把vin和vip的图打出来

作者: 遇见爱0107 时间: 2018-1-30 11:31
回复 20# lynker

你说的是-1dB压缩点吗？

作者: 遇见爱0107 时间: 2018-1-30 11:41
谢谢大家，目前我增大驱动级尺寸，然后把输入级幅度减小，增大了一下op在10M时的LoopGain，现在满足要求了，再次谢谢大家。
我个人觉得原因，主要是因为驱动级不太够导致的，因为驱动不够，导致电压向上或向下下不去，所以才会出现上方和下方都变平的问你，导致THD太差。

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