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标题: 求助vhdl+verdi混合仿真 [打印本页]

作者: heidong123 时间: 2011-10-20 21:03
标题: 求助vhdl+verdi混合仿真
有高手能帮忙吗？由于外购了vhdl的ip，现在自己用verilog写了测试代码做仿真，用ncsim打印出fsdb波形，不知道如何用verdi工具打开代码并看到波形？现在用vericom和vhdlcom编译后verdi能看到混合代码，但是不能看到vhdl代码中信号的波形，这是什么原因？

作者: liujian_2009 时间: 2011-10-20 23:53
不懂啊……

作者: gaurson 时间: 2011-10-21 13:00
外购的IP是RTL代码还是网表？有没有for...generate类似的语句？

作者: warmheard 时间: 2011-10-21 18:12
能不能看到波形跟你的仿真有关，verdi能看到代码只表示verdi编译代码没有问题，至于你的仿真工具有没有dump出波形，跟verdi没有任何关系

看看dump波形时有没有将vhdl部分的波形dump出来，再看看仿真器是否支持VHDL dump

作者: heidong123 时间: 2011-10-21 20:36
回复 3# gaurson

rtl代码和网表都有

作者: heidong123 时间: 2011-10-21 20:46
回复 4# warmheard

我现在是用verilog写测试激励，调用vhdl rtl代码？在verilog激励里面加了这三句话，打印出vhdl波形还要加什么吗？
initial
begin
$fsdbDumpfile（abc_test.fsdb）；
$fsdbDumpvars（0，abc_test）；
$fsdbDumpflush；
end

作者: heidong123 时间: 2011-10-21 20:49
今天打开nWave里面添加信号的窗口只能看到abc_test（verilog代码）无法看到它下面的vhdl代码及vhdl代码的信号，是怎么回事》

作者: heidong123 时间: 2011-10-21 21:09
我现在是用verilog写测试激励abc_test.v，调用vhdl rtl代码abc.vhd及子模块？在verilog激励里面加了这三句话，打印出vhdl波形还要加什么吗？
initial
begin
$fsdbDumpfile（"abc_test.fsdb"）；
$fsdbDumpvars（0，abc_test）；
$fsdbDumpflush；
end

作者: tiangua 时间: 2011-10-22 01:08
用verdi打开fsdb文件，就是波形了。
verdi -ssf XXXXXX.fsdb

作者: heidong123 时间: 2011-10-22 14:51
回复 9# tiangua

问题就是打开了，但是只能看到用verilog写的激励的波形，不能看到激励以下vhdl rtl代码的波形？

作者: dlb05061131 时间: 2011-10-23 17:10
楼主，既然你都有了fsdb，那么就是ncsim混仿已经没有问题了，只不过你不会用verdi而已，看看用户手册，很容易解决你这个问题的。你应该没有在verdi里边编译设计文件。

作者: remnant 时间: 2011-10-23 23:03
需要指定正确的verdi pli。
对于vcs仿真器，verdi pli有3种，一种是纯verilog，一种是纯vhdl，另一种是混合hdl的(Verilog,vhdl,systemverilog)。
你需要指定混合hdl的那个，通常叫做*_mhpi_*，对于其它仿真器也是类似的。
楼主可以看一下verdi安装目录下的PLI目录，就知道了。
对于verdi2010.07版本，当使用ius仿真器时，可以指定PLI，也就是LD_LIBRARY_PATH为pli目录下的IUS（大写），就可以支持mixed hdl了。如果是vcs或vcs_mx则可以指定VCS(大写)，但是这个大写VCS目前还是beta，会出现一个warning，所以还是推荐前面那种指定*_mhpi_*的pli。

作者: remnant 时间: 2011-10-23 23:03
另外说一句，回帖要负责任，不知道的不要瞎说。

作者: zhang2000 时间: 2011-10-25 20:32
楼上应该是对的
modelsim + verdi 仿真.v和.vhd 调用两个不同的pli

作者: cheernixue 时间: 2012-3-23 17:55
12楼完全正确，我碰到过这种问题

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