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标题: PFD设计 [打印本页]

作者: cll412121 时间: 2011-10-11 16:21
标题: PFD设计
我做pll的时候根据其他人的论文里的电路设计了一个上升沿触发的TSPC PFD 但是为什么结果是错的我在两输入端加了反相器变成下降沿触发结果反而对了有人遇到过这种问题吗

作者: jamesccp 时间: 2011-10-12 16:32
上电路图啊。

作者: xhseu 时间: 2011-10-14 16:08
TSPC对时钟的slope很敏感，你说的功能不对，是因为clk上升太慢，从而导致TSPC不能工作，加了反相器加快了时钟的上升速度，所以正常工作

作者: mesko 时间: 2011-10-14 19:35
可以在输入信号前边加两个反相器整形

作者: cll412121 时间: 2011-10-14 20:53
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回复 3# xhseu

后一幅是输入没加反相器，上升沿触发，输出结果起始电位是高电平，加了反相器就如第一幅所示，下降沿触发，结果正确。怎么跟有些论文中的结果不一样呢，还是我哪里错了

作者: cll412121 时间: 2011-10-14 20:56
回复 4# mesko

我输入信号是模拟库中的脉冲源，本身就是理想的，还要整形干什么，输出要整形吧

作者: djallonchina 时间: 2012-7-13 15:18
我的也出现问题，单独仿TSPC没有问题，但是放到PFD里再仿真，就变成上下沿都触发。。不知道什么问题。

作者: cj578009030 时间: 2013-1-18 14:41
我也遇到同样的问题啊，
求大侠解答，谢谢！

作者: s421490542 时间: 2016-5-12 11:28
回复 1# cll412121

楼主能把你的PFD电路图发上来看一下吗？我也在做TSPC PFD，感觉好诡异。。。单独仿真D触发器没问题，但是放在一起就不行了，我想借鉴一下你的电路行不？

作者: xianwu_hs 时间: 2016-12-3 00:36
楼主贴张图啊，我调试两天了，就是没成功

作者: yiqing0725 时间: 2020-3-16 18:01
可以看下输入clk的上下沿时间，太长，会引起pfd误判

作者: sueccy 时间: 2020-3-17 15:49
good question

作者: lurenjie123 时间: 2021-8-19 11:09
我也用了这个TSPC 仿真看是复位和时钟都为0时然后输出是高电平，高电平就影响复位端去了造成初始逻辑混乱后面也就乱了，只能一开始用高电平压制复位端到0，防止逻辑混乱，加反相器之后CLK低电平变成高电平复位为0就能用了也不知道是本是这样

如果错的希望指出

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