Delta Sigma Modulator 的积分器intgerator 外部负载电容大小怎么考虑？

119543213 · 发表于 2019-1-16 19:11:48

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x

设计了

1-bit 2

nd

order Delta-Sigma Modulator

下图为SDtoolbox的CIFF结构图

下图为变成 switched-capacitor的原理图

正在设计

integrator的放大器，

请问第一个integrator的负载有哪些？只有Cc算是负载吗

第二个integrator呢？只有Cb？

感谢

119543213 · 发表于 2023-8-30 01:26:17

本帖最后由 119543213 于 2023-8-30 01:37 编辑

参考书目 understand DS ADC

diabol · 发表于 2023-8-30 03:35:26

本帖最后由 diabol 于 2023-8-30 04:14 编辑

phase 1:
         1st int. output : Cc + c2Cb (c1Cc will effect settling time)
         2nd int. output : Cb
         3rd int. output : Cb + a1Cb + a2Cb
phase 2:

         1st int. output : Cc + a1Cb (b1Cc  and c1Cc  effect settling time)
         2nd int. output : Cb + a2Cb (c2Cb effects settling time)
         3rd int. output : Cb + a1Cb + a2Cb

Be soure at the non-overlap time < tsettle time
and OTA A_open is large enough to hold the transfer function

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