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[招聘] 武汉团队招聘soc design/verification

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发表于 2018-2-9 11:35:34 | 显示全部楼层 |阅读模式

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岗位1:soc design职责
1.soc integration
2.soc synthesis/formal verification/STA

要求:
1.verilog coding + SVA
2. leader 需要>5年经验

岗位2:soc verification
要求:
1.soc verification经验 >1年, leader要>5年
2. hands on UVM experience

岗位3:FPGA prototyping
要求
1. >3年 FPGA原型验证经验
2. soc prototyping 经验最好
发表于 2018-2-10 15:25:04 | 显示全部楼层
什么公司啊?
 楼主| 发表于 2018-2-10 21:10:25 | 显示全部楼层
回复 2# my8310291


    初创团队,可以加我私聊
 楼主| 发表于 2018-2-10 21:12:43 | 显示全部楼层
回复 3# qladxk2008

qq:12378963
可以直接砸简历,也可以加我私聊了解情况
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