LAYOUT 出错（LVS），求助大神，

gl9410 · 发表于 2017-8-28 22:30:58

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之前请教过，但囿于实力，还是想请教下大神，图一是原理图，二，三，分别是布线和LVS结果，小弟现行谢过了。

xxmule · 发表于 2017-8-29 10:36:51

好多人都跟你说了M1，M3的接法有问题，你找个懂电路的给你说说就知道了

回复 1# gl9410

max_max · 发表于 2017-9-2 01:42:17

如果是BIPOLAR的工艺才能这样连。

yhd316 · 发表于 2017-9-7 11:02:55

从图片上看楼主版图接的和电路一样还加了psub2 只是m6 m7 gate floating 要不加个pin 试试

Summerzhang · 发表于 2018-1-18 09:10:59

你的原理图上，M1和M3的栅是不是没有接上，在原理图上那里打了一个叉呀

maomao198477 · 发表于 2018-1-18 12:52:31

基础很重要

powerboy711 · 发表于 2018-1-18 21:24:20

很明显是M1，M3两个MOS管旁边的衬底电位多余，和下面M0，M2的冲突了

limonstone2012 · 发表于 2018-6-13 15:38:13

同意楼上的

wingofray · 发表于 2018-6-14 14:23:02

回复 1# gl9410

这layout要是给到foundary会直接上黑名单吧

w2313190 · 发表于 2018-6-15 15:46:11

M1和M3的BULK电位跟其它的NMOS管不一样

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