3.3V的芯片，如何做5V容忍的GPIO

z77 · 发表于 2017-7-10 21:25:37

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本帖最后由 z77 于 2017-7-10 21:28 编辑

要做一个5V tolerance的GPIO，芯片是3.3V供电，而且只有3.3V的管子可以用。怎么做呢？一头雾水，Input和OD output感觉管子都受不了啊，有什么特殊结构吗？这种情况下，ESD电路怎么做呢？

德布劳内 · 发表于 2017-7-11 15:26:11

肯定会有特殊的layer，去解高压相关的drc。

lenovour · 发表于 2017-7-11 16:36:36

描述一下你的公司的领域，如果不是竞争公司，好说。

z77 · 发表于 2017-7-11 21:08:01

回复 3# lenovour

天下ic一家亲，不吝赐教谢谢您

lenovour · 发表于 2017-7-12 16:13:26

本帖最后由 lenovour 于 2017-7-12 16:17 编辑

回复 4# z77

好吧，亲。思路就是用一个nmos gate接在一个中间电压，让里面器件看到的电压低于3.3V。 PMOS 的衬底要浮起来，让管子任何两点看到的电压都不超过3.3V。

king0798 · 发表于 2017-7-12 17:17:33

本帖最后由 king0798 于 2017-7-12 17:21 编辑

回复 5# lenovour

衬底是否应该串联一个电阻到地，以加强bs的耐压能力？？这个电路放在最前面吗，还是只是作为input的开关？？esd和输出是放在开关的前面还是后面？

king0798 · 发表于 2017-7-12 17:18:09

ESD可以只用NMOS管的结构

tezhi · 发表于 2017-7-12 20:43:05

開了眼界~~~~~~~

謝謝

lenovour · 发表于 2017-7-12 21:49:29

回复 6# king0798

不需要，因为各处的电压都小于3.3v了。用nmos esd 放在里面，因为esd是为了保护更里面的内部电路。

king0798 · 发表于 2017-7-13 08:50:43

你这个tolerance是pad的输入会到5V吗

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