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查看: 6773|回复: 15

[讨论] pll中vco对LPF造成高频纹波的原因是什么

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发表于 2017-6-21 15:34:29 | 显示全部楼层 |阅读模式

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pll锁定后,对控制电压放大后观察,出现低频的纹波抖动之外,还有与参考频率等同的参考杂散造成的毛刺,并且还有很厚的纹波带,也就是包含了高频抖动,该抖动是否为vco的二次谐波(频率确实是vco的两倍),或者还是其他原因? clip_image006.png clip_image007.png clip_image008.png clip_image009.png
发表于 2017-6-22 16:20:52 | 显示全部楼层
kickbak
 楼主| 发表于 2017-6-22 20:03:07 | 显示全部楼层
回复 2# rong00i8


   有木有论文分析过,求分享
发表于 2017-6-23 04:45:51 | 显示全部楼层
回复 3# 胭脂盗

这个不需要论文分析,这是时钟通过寄生电容反馈回来的
发表于 2017-6-23 11:01:17 | 显示全部楼层
呵呵,回踢噪声,这翻译的
发表于 2017-6-23 14:53:38 | 显示全部楼层
如果是回踢频率应该是一样吗?为什么是两倍频?

Limit Cycles in Bang-Bang Phase-Locked Loops@iscas.2006.1693524.pdf

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Limit Cycles in Digital Bang-Bang PLLs.pdf

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Limit Cycles in Bang-Bang Phase-Locked Loops@iscas.2006.1693524.pdf

1.17 MB, 下载次数: 21 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2017-6-23 15:33:10 | 显示全部楼层
楼主,你说的很对。VCO的频率比如是3GHZ,那么VT上面按理说也有个3GHZ,但是隔着一个电容,这两个3GHZ的相位会有差值,所以会互相调制,调制出来的二次谐波就是6GHZ(0HZ天生角色GG)。我暂时认为这个没有办法避免,只能够减小到可以接受的范围。感觉如果你的KVCO不大的话可能可以接受,或者看看增加LPF的电容。


感觉你的环路设计的很好。

本人拙见,诚恳接受各位的指正。
 楼主| 发表于 2017-6-24 12:53:18 | 显示全部楼层
回复 6# lenovour


  感谢,我得好好看一看啦
 楼主| 发表于 2017-6-24 12:55:03 | 显示全部楼层
回复 7# 行三米

感谢,其实我的环路滤波器的电容特别大,为了满足100khz的环路带宽,电容足足到了360pF,不知道到时候是否要做到片外?
发表于 2019-7-8 21:58:14 | 显示全部楼层
最后怎么解决的?
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