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楼主: coyoo

[解决] 基于FPGA高精度TDC设计

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发表于 2013-7-31 21:21:29 | 显示全部楼层
回复 30# coyoo


   知道了,谢谢啊
发表于 2013-9-3 15:54:51 | 显示全部楼层
楼主可以分享下!
 楼主| 发表于 2013-9-4 17:51:19 | 显示全部楼层
发表于 2013-9-5 16:03:15 | 显示全部楼层
回复 33# coyoo

兄弟,哪里的?以前我们隔壁实验室用fpga做TDC很强啊,
用在物理实验里面的,TOF用的。
 楼主| 发表于 2013-9-6 11:45:11 | 显示全部楼层


回复  coyoo

兄弟,哪里的?以前我们隔壁实验室用fpga做TDC很强啊,
用在物理实验里面的,TOF用的。
wuzenghai 发表于 2013-9-5 16:03



这个东东就是一个小众应用,想了解详细情况,可以到这边看看:

http://bbs.ednchina.com/BLOG_PERSONALCAT_100226_41415.HTM
发表于 2013-9-6 12:01:07 | 显示全部楼层
回复 35# coyoo


    原来是Jerry啊,眼睛不好没注意啊!有空指导指导我啊!!
发表于 2013-9-6 21:04:52 | 显示全部楼层
只有话语,木有东西
发表于 2014-7-26 10:42:13 | 显示全部楼层
hello,请问tdc延时链的输出锁存时候的亚稳态怎么处理的,着急!
 楼主| 发表于 2014-7-27 08:47:15 | 显示全部楼层


hello,请问tdc延时链的输出锁存时候的亚稳态怎么处理的,着急!
xiaomai515 发表于 2014-7-26 10:42

一般使用延时单元隔壁的寄存器就不大会存在亚稳态问题,因为从延时单元到这个寄存器的之间的延时非常小
发表于 2014-7-27 15:48:46 | 显示全部楼层
回复 39# coyoo

可是,要锁存靠近时钟上升沿附近的延时链的1到0的跳变就很容易出现亚稳态了啊!modlesim仿真显示出来了!
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