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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 去某外企面试被问到的问题2：Capless LDO中开环共轭极点 ...
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楼主: crown911

[讨论] 去某外企面试被问到的问题2：Capless LDO中开环共轭极点

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ft1983
发表于 2013-4-8 06:36:09 | 显示全部楼层
我仿了一下这个电路，用的TSMC.35工艺，仿真不正确啊
首先请问M2/M3，M2/M4管的作用是什么，为什么这么联？
另外对于current mirror，采用最小尺寸合适吗？paper用的.35工艺，而current mirror管Mf1, Mf2的Length是0.4um，太小了吧


回复 8# ef321
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ft1983
发表于 2013-4-8 06:44:29 | 显示全部楼层
请问你是怎么仿的，我用的同样的工艺仿不出来啊




按照此电路做了个电路流片了，仿真没问题，但测试出来结果：在数字模块打开时（此块数字电路规模较大），输 ...
accel30 发表于 2012-11-9 15:15

                               
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万水之源
发表于 2013-4-9 12:03:51 | 显示全部楼层
学习了
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坚强
发表于 2013-4-9 13:51:17 | 显示全部楼层
回复 37# hadeheng


    同学习！
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寂寞英雄
发表于 2013-4-9 19:07:35 | 显示全部楼层
正要找capless的资料呢！郁闷当中！
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ryanbowen40
发表于 2013-5-3 13:38:57 | 显示全部楼层
按照此电路做了个电路流片了，仿真没问题，但测试出来结果：在数字模块打开时（此块数字电路规模较大），输出电压容易跑掉，拉不回来。

是电流小了？带宽不够吗？
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luqcheng
发表于 2013-10-28 15:36:30 | 显示全部楼层
mark一下
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spore
发表于 2013-10-28 18:42:34 | 显示全部楼层
被共轭极点弄得有点晕了。。。研究xia
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zjw922169
发表于 2014-2-2 16:34:51 | 显示全部楼层
项目上碰到类似的问题了，希望能在资料上找到答案，谢谢
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laxbeibei
发表于 2014-2-10 10:07:01 | 显示全部楼层
MARK 一下
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