verilogA建模，电流赋值

IC2019 · 发表于 2021-8-6 16:35:59

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verilogA建模中，如果模块有偏置电流输入，那么如何赋值， real i1=Isource？？？

quantus · 发表于 2021-8-6 16:57:23

parameter real
这是定义偏置电流吧。如果是输入就写写成端口的形式

IC2019 · 发表于 2021-8-6 17:12:11

quantus 发表于 2021-8-6 16:57
parameter real
这是定义偏置电流吧。如果是输入就写写成端口的形式

不是具体数值，module 后面有端口  Ibias  Ioutinput [1:0]Ibias
output [1:0]Iout
我是想定义一个实数real  i1[1:0]

然后将I1[1:0]=[1:0]Ibias

但是这个是错的，不知道是=，<+  还是其他的？我用这两个都是错的

phoenixson · 发表于 2021-8-6 17:45:43

我觉得最好还是先看看VAMS-LRM 文档

quantus · 发表于 2021-8-6 20:02:12

IC2019 发表于 2021-8-6 17:12
不是具体数值，module 后面有端口 Ibias Ioutinput [1:0]Ibias
output [1:0]Iout
我是想定义一个实数re ...

定义成inout和electrical就可以了，同楼上的意见一样，还是建议看看基本的va的资料吧

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