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[原创] Designware(DW_mult_seq)使用注意点

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发表于 2020-6-28 16:33:14 | 显示全部楼层 |阅读模式

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今天使用Designware设计多周期乘法器(192bit*32bit)时,调用DW_mult_seq模块,结果综合的时候一直报错,mapping出错,发现是由于例化的时候,输入端A连接了192位的输入,输入端B连接了32位的输入。
解决方法:A端连接32位的输入,B端连接192位的输入。

发表于 2020-7-28 09:59:41 | 显示全部楼层
請問您說的maping是指在FPGA的map嗎?
发表于 2021-1-23 14:51:08 | 显示全部楼层
你这个用了几级流水的ip,跑的频率多少
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