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[求助] 运放失调的问题

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发表于 2020-3-28 15:21:24 | 显示全部楼层 |阅读模式

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本帖最后由 iamtorres9 于 2020-3-30 21:35 编辑

MC仿真能够帮助我们得到失调电压的统计分布。但是版图匹配不一样,流片出来的电路,失调又不一样。
想请教一下假设我现在一个运放,MC仿真失调电压,中心值0.8mV,1sigma=1.3mV。
那么在考虑版图匹配和不那么匹配的情况,实际流片的电路,失调电压能有多大?

今天去看了版图的艺术,关于匹配的讲解,感触颇多!感谢各位的回答,如果还有有问题的地方我会在帖子里讨论。
 楼主| 发表于 2020-3-28 16:55:55 | 显示全部楼层
给自己顶一个
发表于 2020-3-28 18:18:19 | 显示全部楼层
仿真出来的结果是基于版图匹配的基础上的
 楼主| 发表于 2020-3-28 19:39:50 | 显示全部楼层


acging 发表于 2020-3-28 18:18
仿真出来的结果是基于版图匹配的基础上的


但是版图匹配也会有好和坏,想问一下mc出来的结果,对应的版图匹配很严格吗?
发表于 2020-3-28 20:05:59 | 显示全部楼层


iamtorres9 发表于 2020-3-28 19:39
但是版图匹配也会有好和坏,想问一下mc出来的结果,对应的版图匹配很严格吗?
...


不严格,只要按照基本的匹配方法,layout造成的失配一般是小部分。
有些foundry会有专门指导layout匹配的文档,比如要加多少宽的dummy等。
发表于 2020-3-28 22:23:51 | 显示全部楼层
看啥工艺吧,不要看1sigma,看3sigma。
layout后仿跑个MC看看呢。
好一点的工艺,一般MC还是准的。
如果怀疑工艺,可以看看找PE看看WAT数据。
发表于 2020-3-29 17:46:15 | 显示全部楼层
这个看工艺吧,,工艺不同差别较大。
发表于 2020-3-30 13:02:45 | 显示全部楼层
失调有随机性失调与确定性失调,后者是版图,可以减小,前者可以靠面积等
发表于 2020-4-3 18:02:26 | 显示全部楼层
MC仿真model给出来的数据是要求版图匹配的情况下得到的。版图没匹配好,失配会加大不少。
发表于 2020-4-3 19:41:26 | 显示全部楼层
3个σ范围内的概率是99.73%
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