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[原创] RISC-V开源核汇总

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发表于 2020-2-17 10:41:31 | 显示全部楼层 |阅读模式

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补充内容 (2020-2-28 16:33):
wujian100
SweRV EH1


补充内容 (2020-4-3 17:17):
加我微信591522680,拉你进入FPGA技术交流群
发表于 2020-2-17 17:30:34 | 显示全部楼层
汇总得不错!
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发表于 2020-2-17 18:18:35 | 显示全部楼层
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发表于 2020-2-18 01:59:55 | 显示全部楼层
这个是重量级的,
SweRV EH1Western Digital CorporationGitHubRV32IMCSystemVerilogApache 2.0

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发表于 2020-2-18 09:19:25 | 显示全部楼层
有效能的評比資訊嗎?
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发表于 2020-2-21 08:56:22 | 显示全部楼层
Thanks
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发表于 2020-2-21 09:35:20 | 显示全部楼层
A Good Information.
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 楼主| 发表于 2020-2-28 16:23:56 | 显示全部楼层


   
gxliu 发表于 2020-2-17 18:18
https://github.com/riscv/riscv-cores-list


这才是精华,学习一下
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 楼主| 发表于 2020-2-28 16:24:43 | 显示全部楼层


   
s_ki1001 发表于 2020-2-18 01:59
这个是重量级的,


是的,一个很好的学习资料
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发表于 2020-3-3 12:50:58 | 显示全部楼层
nbnbnbn
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