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汽车功能电子化、ADAS及自动驾驶等汽车电子资料合集
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[求助] vcs编译system verilog 出现了一个问题

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发表于 2019-1-6 01:00:23 | 显示全部楼层 |阅读模式

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System verilog  keyword 'endpackage' is not expected to be used in this    context.
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不知道是什么原因
发表于 2019-1-6 11:22:12 | 显示全部楼层
说明include进来的文件有问题,可能是少了endclass/end/endtask/endfunction
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 楼主| 发表于 2019-1-6 13:54:28 | 显示全部楼层
回复 2# e_epsh 谢谢
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