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楼主: hudie2002

VHDL还有前途吗?

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发表于 2007-11-16 19:27:47 | 显示全部楼层

re

关键是数字电路功底,以及相关的专业知识
发表于 2007-11-17 10:59:27 | 显示全部楼层
欧美的公司用的比较多. 相对于Verilog而言比较严谨. 上手比较慢.
发表于 2007-11-19 11:59:46 | 显示全部楼层
有。 但如果在verilog/VHDL之间选择,请选择 verilog.
发表于 2007-11-19 17:00:13 | 显示全部楼层
一种语言只要用的熟悉了,就不会感到麻烦了,VHDL也一样
同时个人感觉VHDL相对来说规范一点,这也是学校一般用VHDL的原因吧
发表于 2007-11-19 23:40:09 | 显示全部楼层
好象用verilog的多点吧
发表于 2007-11-19 23:41:14 | 显示全部楼层
好象用verilog的多点吧
发表于 2007-11-20 18:07:46 | 显示全部楼层
做设计一般两样都要懂啊,不然看不懂别人的代码也很麻烦的
发表于 2007-11-20 23:47:23 | 显示全部楼层
环境决定选择阿,无论什么都要符合需求才可以
发表于 2007-11-21 17:41:17 | 显示全部楼层
verilog好理解了,vhdl总的来说结构复杂,不过从vhdl转到verilog很容易的,
发表于 2007-11-22 06:30:43 | 显示全部楼层
I like VHDL!
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